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  • 量化补缺与量化紧缩
    量化补偿与量化紧缩  学习博客:http://lhtao31.blog.163.com/blog/static/2972647020103814044158/   最近在学习调试摄像头,装备OV7670摄像头收集到的数据是RGB565,移植他人的代码,从ZYNQ移
    网友共享于:2017-10-18 11:52:11
  • 关于AVALON总路线动态地址对齐
    关于AVALON总线动态地址对齐       在NIOS的运用中,咱们往往要用到自定义外设,然后经过AVALON交流架构和NIOSII进行通讯。            AVA
    网友共享于:2017-10-10 12:55:52
  • verilog-行为级描绘和结构级描绘
    verilog--行为级描绘和结构级描绘1、在运用verilog描绘电路时,既能够进行行为级的描绘,也能够进行结构级的描绘。       ①行为级描绘:偏重对模块行为功用的笼统描绘。       ②结构级描绘
    网友共享于:2017-10-10 12:55:52
  • 依据FPGA的腐蚀胀大算法完成
    依据FPGA的腐蚀胀大算法完成         本篇文章我要写的是依据的腐蚀胀大算法完成,腐蚀胀大是形态学图画处理的根底,,腐蚀在二值图画的根底上做“缩短”或“细化”操作,胀大在二值图画的根底上做“加
    网友共享于:2017-10-07 20:18:33
  • 依据FPGA驱动VGA显现图片的小疑点
    依据FPGA驱动VGA显现图片的小问题         学习VGA显现图片的进程中,遇到了一个小问题,我在显现屏上开了一个60x60的框,放了一张图片进去显现,可是终究的成果如下图所示。   呈现了一个竖黑边,看了看代码,
    网友共享于:2017-10-07 20:18:33
  • 串口发送模块——一字节数据发送
    串口发送模块——1字节数据发送  规划思维与代码标准均学习明德扬至简规划法,有缺乏之处期望咱们多提主张,真实做到至简规划。本篇侧重提出FPGA通用规划思维,以计数器为中心的代码标准以及VIVADO debug操作流程。   此次实验旨在经过串口实验,叙述FPGA
    网友共享于:2017-08-21 14:24:37
  • 依据FPGA的VGA展现静态图片
    依据FPGA的VGA显现静态图片  总算熬到暑假了,记过三四周的突击带考试,总算为我的大二画上了一个完好的句号,接下来总算能够静心去做自己想做的作业了,前一阵子报了一个线上训练班,学学Sobel边际检测,之前一向在学习图画处理,可是因为一向看人家的代码,到后来
    网友共享于:2017-08-21 14:24:37
  • nRF2401无线模块接纳_FPGA完成~
    nRF2401无线模块接纳_FPGA完成~~    最近胶囊内窥镜项目顶用到了业界常用的无线收发模块,即恩智浦公司nRF系列无线收发模块,该模块当时有好几种挑选,比方nRF24L01只需无线收发模块,需求外部MCU进行驱动及
    网友共享于:2017-08-15 14:35:09
  • 全网始创ISE入门级教程
    全网开创ISE入门级教程   转眼间我现已大三了,现在成为了实验室的负责人,关于下一届学生的纳新重担就交到了我的手上,想采纳不同的办法暑假尽可能对他们进行一些训练,所以制作了此教程,说实话,在网上还没有找到关于ISE的入门级运用教程呢!可谓是全网开创啊!话不多说,咱们赶忙看看我的童贞视频
    网友共享于:2017-08-15 14:35:09
  • 状况机规划——从简略的按键消抖开端
    状况机规划——从简略的按键消抖开端  现在笔者正在承受明德扬FPGA网上训练班的训练,讲的内容十分合适新手,且以操练和互动答疑的教育形式让我学到了许多东西。由所以依据本身时刻组织进展的,所以阵线拉的比较长,发现做些规划总结十分重要,能够协助自己理清思路,一起也能得到很
    网友共享于:2017-08-15 14:35:09
  • Modelsim运用常见有关问题集锦(实时更新)
    Modelsim运用常见问题集锦(实时更新)1.Modelsim运用时呈现闪退状况,解决办法:(1)请再次检查modelsim是否破解彻底;(2)电脑上装置的文件与Modelsim有抵触,多半是爱奇艺这个软件,删掉爱奇艺软件。 2.再运用mo
    网友共享于:2017-07-21 18:43:24
  • FPGA根底知识(3)典型FPGA开发流程
    FPGA根底知识(三)典型FPGA开发流程FPGA的规划流程便是运用EDA开发软件和编程东西对FPGA芯片进行开发的进程。FPGA的开发流程一般下如图所示,包含电路规划、规划输入、功用仿真、归纳优化、归纳后仿真、完成、布线后仿真、板级仿真以及芯片编程与调试等首要过程。   1. 电路规划 在体系
    网友共享于:2017-07-12 16:03:16
  • MATLAB规划不同结构的FIR或IIR滤波器
    MATLAB规划不同结构的FIR或IIR滤波器  网上许多教程都是运用MATLAB的FDATool东西规划滤波器,然后将系数导出,放到IP核中,由IP核依据数据速率核主处理时钟来决议滤波器的结构。这种规划方法很便利可是不灵敏,有时会碰到这种状况:咱们需求一个FIR滤波器,数据速率和主处理时钟速率都很高,乃至一
    网友共享于:2017-06-28 09:02:31
  • 并串转化FPGA电路结构的讨论
    并串转化FPGA电路结构的讨论如题,并串转化时FPGA规划里,一个很常用的模块,这里有一个小的讨论。   一般状况下咱们能够运用一个计数器与数据挑选器进行并串转化,如下图的的结构。这个结构经过计数器不断的改动数据挑选器的地址端,从而使并行输入的数据,串行的输出。
    网友共享于:2017-06-28 09:02:31
  • Xilinx 学习笔记1-新建工程跟创立源代码文件
    Xilinx 学习笔记1---新建工程和创立源代码文件  最近总算有空能够记载一些之前学习的内容,本博客系列记载笔者Xilinx ISE学习之旅,当然现在Vivado是学习抢手,一步一步来。搞定 ISE,Vivado上手也会很快。
    网友共享于:2017-06-28 09:02:31
  • FPGA根底知识(4)锁存器、触发器、寄存器和缓冲器的差异
    FPGA根底知识(四)锁存器、触发器、寄存器和缓冲器的差异一、锁存器锁存器(latch)---对脉冲电平灵敏,在时钟脉冲的电平效果下改动状况锁存器是电平触发的存储单元,数据存储的动作取决于输入时钟(或许使能)信号的电平值,仅当锁存器处于使能状况时,输出才会跟着数据输入发生变化。锁存器不同于触发器,它不在锁存数据时,
    网友共享于:2017-06-28 09:02:31
  • FPGA规划模板共享(二)-verilog常用模板共享
    FPGA规划模板共享(2)--verilog常用模板共享 FPGA工程师都知道,Verilog代码绝大部分都是always句子,结构基本上都是共同的,为了削减重复性的作业,让工程师专心于规划完成,明德扬精心制作了常用模板,只需你装置好明德扬供给的GVIM,就能运用这些模板了。1.时序逻辑的模板在GVIM
    网友共享于:2017-05-08 13:29:58
  • 关于Test-Pattern Generator IP核的测验
    关于Test--Pattern Generator IP核的测验关于Test--Pattern Generator IP核的测验 1.Test--Pattern Generator 功用介绍 生成24-bit RGB视频流,此IP核能够用于体系
    网友共享于:2017-04-20 22:47:07
  • 异步复位、同步开释机制——体系完美安稳
    异步复位、同步开释机制——体系完美安稳  白驹过隙,寒假现已余额缺乏,回头想想,也便是看了两本书,做了几个并不大的工程,看着QQ群里边一些大神们谈天,时不时有的没的还插几句,一句话没人理也是正常作业。有时候还帮同是菜鸟的网友解决问题,好不为难!在大神们的只言片语中,也罗致出来一点对职业的知道,数电、
    网友共享于:2017-04-20 22:47:07
  • V3学院带你学习-缩水汉明码Hamming(12,8)的FPGA完成
    V3学院带你学习-缩短汉明码Hamming(12,8)的FPGA完成此文章为原创出自 V3学院 www.v3edu.org,FPGA训练专家 汉明码是一种完成简略而且能够检测和纠正过错的编码, 汉明码是在原编码的根底上附加一部分数据比特,使其满意纠错码的条件。它归于线性分组码,因为线性码的编码和译码简略完成,
    网友共享于:2017-05-02 19:55:05
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